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問(wèn)題已開(kāi)啟
(普通問(wèn)題)
為了提高通信系統(tǒng)的可靠性，如何解決幀同步的問(wèn)題？
在一個(gè)無(wú)線通信系統(tǒng)中，為了提高通信系統(tǒng)的可靠性，想在數(shù)據(jù)發(fā)送端編碼完成后給每組數(shù)據(jù)（15個(gè)碼字一組）添加一個(gè)幀頭，在接收端檢測(cè)幀頭無(wú)誤后去掉幀頭，然后接受數(shù)據(jù)，這個(gè)過(guò)程想用硬件fpga實(shí)現(xiàn)，verilogHDL語(yǔ)言編程實(shí)現(xiàn)，求哪位大俠給個(gè)設(shè)計(jì)思路或者實(shí)現(xiàn)方法更好！現(xiàn)在還沒(méi)積分，還望各位能慷慨能助小弟一臂之力！
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幀同步
同步
高通
通信系統(tǒng)
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問(wèn)題答案
( 1 )
軟件無(wú)線電，加建幀頭好像是可以實(shí)現(xiàn)的，國(guó)外的某個(gè)通信網(wǎng)站上好像有。
回答者：
藍(lán)培清
回答時(shí)間：2012-06-24 08:40
8
5
不是，用verilog語(yǔ)言在fpga硬件實(shí)現(xiàn)電路，有見(jiàn)過(guò)的類(lèi)似的設(shè)計(jì)給個(gè)詳細(xì)設(shè)計(jì)步驟或者網(wǎng)址，ok？thank you!
junyou 2012-06-24 08:54
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