FPGA可重復(fù)配置和測(cè)試系統(tǒng)的實(shí)現(xiàn)

從制造的角度來(lái)講，F(xiàn)PGA測(cè)試是指對(duì)FPGA器件內(nèi)部的邏輯塊、可編程互聯(lián)線、輸入輸出塊等資源的檢測(cè)。完整的FPGA測(cè)試包括兩步，一是配置FPGA、然后是測(cè)試FPGA，配置FPGA是指將FPGA通過(guò)將配置數(shù)據(jù)下載編程使其內(nèi)部的待測(cè)資源連接成一定的結(jié)構(gòu)，在盡可能少的配置次數(shù)下保證FPGA內(nèi)部資源的測(cè)試覆蓋率，配置數(shù)據(jù)稱為TC，配置FPGA的這部分時(shí)間在整個(gè)測(cè)試流程占很大比例；測(cè)試FPGA則是指對(duì)待測(cè)FPGA施加設(shè)計(jì)好的測(cè)試激勵(lì)并回收激勵(lì)，測(cè)試激勵(lì)稱為TS。

通常來(lái)說(shuō)，要完成FPGA內(nèi)部資源的完整測(cè)試需要針對(duì)不同的待測(cè)資源設(shè)計(jì)多種配置圖形，多次下載到FPGA，反復(fù)施加激勵(lì)和回收測(cè)試響應(yīng)，通過(guò)對(duì)響應(yīng)數(shù)據(jù)的分析來(lái)診斷故障。因此，用于FPGA測(cè)試的儀器或系統(tǒng)的關(guān)鍵技術(shù)在于：如何加快單次配置的時(shí)間，以節(jié)省測(cè)試過(guò)程中的配置時(shí)間開(kāi)銷；如何實(shí)現(xiàn)自動(dòng)重復(fù)配置和測(cè)試，將FPGA較快速度的在線配置和快速測(cè)試結(jié)合起來(lái)。

由于一般的集成電路自動(dòng)測(cè)試儀ATE為通用IC測(cè)試設(shè)計(jì)，但FPGA測(cè)試有上述特殊性，在芯片功能測(cè)試之前必須對(duì)其進(jìn)行特定的配置，否則芯片是不具備內(nèi)部電路結(jié)構(gòu)的，內(nèi)部資源將無(wú)法測(cè)試，而通用的ATE要完成測(cè)試步驟中的配置功能時(shí)，需要以人工或通過(guò)電腦專門編程修改配置數(shù)據(jù)生成測(cè)試系統(tǒng)可執(zhí)行的測(cè)試激勵(lì)形式進(jìn)行配置，且如果配置數(shù)據(jù)較多，這個(gè)轉(zhuǎn)換過(guò)程將可能比較復(fù)雜，易用性不強(qiáng)，無(wú)法高效地用于FPGA器件的測(cè)試中，需要對(duì)FPGA測(cè)試設(shè)計(jì)專用的測(cè)試平臺(tái)以滿足其配置測(cè)試需求。

我們?cè)O(shè)計(jì)的系統(tǒng)實(shí)現(xiàn)了快速重復(fù)配置和測(cè)試的功能，配置數(shù)據(jù)可以直接引用EDA軟件生成的位流文件而不需要像ATE一樣轉(zhuǎn)換成繁雜的測(cè)試激勵(lì)形式，相較于ATE有一定的優(yōu)勢(shì)，對(duì)FPGA測(cè)試有一定的使用價(jià)值。

FPGA可重復(fù)配置和測(cè)試系統(tǒng)結(jié)構(gòu)概述

系統(tǒng)框圖如圖1所示。

圖1 可重復(fù)配置測(cè)試系統(tǒng)結(jié)構(gòu)框圖

統(tǒng)功能的實(shí)現(xiàn)包括軟件和硬件兩部分。硬件部分包含PCI橋接芯片、FPGA1中的數(shù)據(jù)接口模塊、配置模塊、測(cè)試模塊和被測(cè)FPGA。軟件部分包含對(duì)實(shí)現(xiàn)FPGA配置部分的代碼和實(shí)現(xiàn)FPGA測(cè)試部分的代碼。FPGA1中的各硬件模塊通過(guò)EDA軟件以JTAG接口固化FPGA1中，其中FPGA1中的配置模塊負(fù)責(zé)接收來(lái)自PC方軟件發(fā)送的配置數(shù)據(jù)，并產(chǎn)生對(duì)被測(cè)FPGA的配置時(shí)序，完成配置步驟，測(cè)試模塊負(fù)責(zé)發(fā)送測(cè)試激勵(lì)和回收被測(cè)FPGA的響應(yīng)數(shù)據(jù)，等待PC方軟件的回收。

系統(tǒng)軟硬件交互流程

整個(gè)系統(tǒng)通過(guò)軟硬件的數(shù)據(jù)交互實(shí)現(xiàn)對(duì)被測(cè)FPGA的自動(dòng)配置和測(cè)試的流程，軟硬件交互的流程從圖2可以體現(xiàn)：系統(tǒng)啟動(dòng)后，首先需要開(kāi)始對(duì)被測(cè)FPGA進(jìn)行數(shù)據(jù)配置，由軟件向硬件發(fā)送配置開(kāi)始指令，硬件接收指令后對(duì)被測(cè)FPGA產(chǎn)生配置開(kāi)始的時(shí)序，告訴被測(cè)FPGA準(zhǔn)備接收配置數(shù)據(jù)。當(dāng)軟件查詢到配置模塊中的狀態(tài)寄存器值代表等待數(shù)據(jù)時(shí)開(kāi)始發(fā)送配置數(shù)據(jù)。配置數(shù)據(jù)發(fā)送完成后，軟件通過(guò)讀取配置模塊的狀態(tài)寄存器值判斷配置是否成功，決定是否可以開(kāi)始測(cè)試。如果配置成功，軟件則開(kāi)始向被測(cè)FPGA發(fā)送測(cè)試激勵(lì)數(shù)據(jù)并讀回測(cè)試響應(yīng)保存在電腦中，由軟件對(duì)測(cè)試響應(yīng)進(jìn)行分析決定是否需要進(jìn)行下一次配置和測(cè)試流程。如果需要，在一定的延時(shí)之后軟硬件將回復(fù)初始狀態(tài)，并選擇新的配置數(shù)據(jù)和測(cè)試數(shù)據(jù)，開(kāi)始新一輪的配置后測(cè)試流程。

圖2 FPGA芯片自動(dòng)重復(fù)下載自動(dòng)測(cè)試系統(tǒng)軟硬件交互流程圖